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Arquitectura de hardware eficiente para cifrado multimedia

Arquitectura de hardware eficiente para cifrado multimediavon Gaddam Sunil Kumar Sie sparen 19% des UVP sparen 19%
Über Arquitectura de hardware eficiente para cifrado multimedia

Este libro presenta un esquema de seguridad sin sobrecarga para sistemas de procesamiento digital de imágenes embebidos en tiempo real. El bloque de compresión de la Transformada Wavelet Discreta (DWT) se construye utilizando un enfoque parametrizado, introduciendo un parámetro libre en el diseño. Para crear este bloque de compresión DWT parametrizado, utilizamos un banco de filtros wavelet biortogonales. Este enfoque permite establecer un espacio de claves para el cifrado multimedia ligero. La parametrización produce coeficientes racionales, lo que da lugar a una eficiente implementación hardware en coma fija. Este método, que alcanza una velocidad de reloj de más de 244 MHz en una FPGA Xilinx Virtex 2P, resulta muy eficaz. Una comparación con los enfoques existentes pone de relieve las ventajas significativas en términos de rendimiento y sobrecarga de hardware cuando se integran características de seguridad en la arquitectura DWT.

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  • Sprache:
  • Spanisch
  • ISBN:
  • 9786207193622
  • Einband:
  • Taschenbuch
  • Seitenzahl:
  • 180
  • Veröffentlicht:
  • 23. Februar 2024
  • Abmessungen:
  • 150x11x220 mm.
  • Gewicht:
  • 286 g.
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Beschreibung von Arquitectura de hardware eficiente para cifrado multimedia

Este libro presenta un esquema de seguridad sin sobrecarga para sistemas de procesamiento digital de imágenes embebidos en tiempo real. El bloque de compresión de la Transformada Wavelet Discreta (DWT) se construye utilizando un enfoque parametrizado, introduciendo un parámetro libre en el diseño. Para crear este bloque de compresión DWT parametrizado, utilizamos un banco de filtros wavelet biortogonales. Este enfoque permite establecer un espacio de claves para el cifrado multimedia ligero. La parametrización produce coeficientes racionales, lo que da lugar a una eficiente implementación hardware en coma fija. Este método, que alcanza una velocidad de reloj de más de 244 MHz en una FPGA Xilinx Virtex 2P, resulta muy eficaz. Una comparación con los enfoques existentes pone de relieve las ventajas significativas en términos de rendimiento y sobrecarga de hardware cuando se integran características de seguridad en la arquitectura DWT.

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