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Eine effiziente Hardware-Architektur für Multimedia-Verschlüsselung

Über Eine effiziente Hardware-Architektur für Multimedia-Verschlüsselung

In diesem Buch wird ein Zero-Overhead-Sicherheitsschema für eingebettete digitale Echtzeit-Bildverarbeitungssysteme vorgestellt. Der Kompressionsblock für die diskrete Wavelet-Transformation (DWT) wird mit einem parametrisierten Ansatz konstruiert, der einen freien Parameter in das Design einführt. Um diesen parametrisierten DWT-Kompressionsblock zu erstellen, verwenden wir eine biorthogonale Wavelet-Filterbank. Dieser Ansatz ermöglicht die Einrichtung eines Schlüsselraums für eine leichtgewichtige Multimedia-Verschlüsselung. Die Parametrisierung führt zu rationalen Koeffizienten und damit zu einer effizienten Festkomma-Hardware-Implementierung. Mit einer Taktrate von über 244 MHz auf einem Xilinx Virtex 2P FPGA erweist sich diese Methode als äußerst effektiv. Ein Vergleich mit bestehenden Ansätzen zeigt die signifikanten Vorteile in Bezug auf Durchsatz und Hardware-Overhead bei der Integration von Sicherheitsfunktionen in die DWT-Architektur.

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  • Sprache:
  • Deutsch
  • ISBN:
  • 9786207193615
  • Einband:
  • Taschenbuch
  • Seitenzahl:
  • 192
  • Veröffentlicht:
  • 23 Februar 2024
  • Abmessungen:
  • 150x12x220 mm.
  • Gewicht:
  • 304 g.
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Beschreibung von Eine effiziente Hardware-Architektur für Multimedia-Verschlüsselung

In diesem Buch wird ein Zero-Overhead-Sicherheitsschema für eingebettete digitale Echtzeit-Bildverarbeitungssysteme vorgestellt. Der Kompressionsblock für die diskrete Wavelet-Transformation (DWT) wird mit einem parametrisierten Ansatz konstruiert, der einen freien Parameter in das Design einführt. Um diesen parametrisierten DWT-Kompressionsblock zu erstellen, verwenden wir eine biorthogonale Wavelet-Filterbank. Dieser Ansatz ermöglicht die Einrichtung eines Schlüsselraums für eine leichtgewichtige Multimedia-Verschlüsselung. Die Parametrisierung führt zu rationalen Koeffizienten und damit zu einer effizienten Festkomma-Hardware-Implementierung. Mit einer Taktrate von über 244 MHz auf einem Xilinx Virtex 2P FPGA erweist sich diese Methode als äußerst effektiv. Ein Vergleich mit bestehenden Ansätzen zeigt die signifikanten Vorteile in Bezug auf Durchsatz und Hardware-Overhead bei der Integration von Sicherheitsfunktionen in die DWT-Architektur.

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